Rechnerarchitektur (Übungen) |
Untertitel: |
Diese Lehrveranstaltung ist Teil des Moduls: Rechnerarchitektur |
Semester: |
WiSe 23/24 |
Veranstaltungstyp: |
Übung (Lehre) |
Veranstaltungsnummer: |
lv1864_w23 |
DozentIn: |
Prof. Dr. Heiko Falk, Dr. Kateryna Muts, M. Sc Eugen Romanenkov, M. Sc Thilo Fischer, Wolfgang Brandt |
Beschreibung: |
- Einführung
- Grundlagen von VHDL
- Programmiermodelle
- Realisierung elementarer Datentypen
- Dynamisches Scheduling
- Sprungvorhersage
- Superskalare Maschinen
- Speicher-Hierarchien
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Leistungsnachweis: |
310 - Rechnerarchitektur<ul><li>310 - Rechnerarchitektur: Klausur schriftlich</li></ul><br>m791 - Rechnerarchitektur<ul><li>p298 - Rechnerarchitektur: Klausur schriftlich</li><li>vl224 - Freiwillige Studienleistung Rechnerarchitektur - Fachtheoretisch-fachpraktische Studienleistung: Fachtheoretisch-fachpraktische Studienleistung</li></ul> |
ECTS-Kreditpunkte: |
1 |
Weitere Informationen aus Stud.IP zu dieser Veranstaltung |
Heimatinstitut: Institut für Eingebettete Systeme (E-13)
In Stud.IP angemeldete Teilnehmer: 174
Anzahl der Dokumente im Stud.IP-Downloadbereich: 1
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